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《SystemVerilog验证方法学-实战》3月
第4任务: Verification Environment
查看课程
任务列表
第1任务: 第一次开课班会
第2任务: Verilog Testbench
第3任务: ASIC SystemVerilog Functional Verification
第4任务: Verification Environment
第5任务: DUTspec讲解
第6任务: svvlab1讲解
第7任务: SystemVerilog Interfaces, program
第8任务: SystemVerilog Interfaces 续
第9任务: SystemVerilog data types first part
第10任务: SystemVerilog data types second part
第11任务: System Verilog Data Types second part 续
第任务: System Verilog Data Types second part 续-下载资料
第12任务: SystemVerilog Tasks and Functions
第任务: SystemVerilog Tasks and Functions-下载资料
第13任务: Object Oriented Programming
第14任务: Object Oriented Programming 续
第15任务: Object Oriented Programming 续2
第16任务: Randomization
第17任务: System Verilog Coverage
第18任务: lab01,lab02讲解
第19任务: System Verilog Coverage
第20任务: System Verilog Assertion Summary
第21任务: SystemVerilog Assertion Sequence
第22任务: System Verilog Assertion Property
第23任务: lab4,lab5讲解
第24任务: SV Project SRAMC
第25任务: SV Project SRAMC 续1
第26任务: SV Project SRAMC 续2