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《数字前端设计工程师就业班》2009期
第53任务： AHB-eflash控制器设计5
查看课程
任务列表
第1任务： 课程简介
第2任务： 数字IC设计全流程介绍
第3任务： Linux操作系统
第4任务： Linux操作系统2
第5任务： gvim文本编辑工具
第6任务： gvim正则表达式
第7任务： 逻辑仿真工具VCS
第8任务： 逻辑综合工具 - Design Compiler
第9任务： 数字电路基础1
第10任务： 数字电路基础2
第11任务： Verilog RTL 设计 - 数据类型
第12任务： Verilog RTL 设计 - 操作符和过程控
第13任务： Verilog RTL 设计 - task_function
第14任务： Verilog RTL 设计 - 并发线程
第15任务： Verilog RTL 设计 - 经典组合和时序电路的设计
第16任务： Verilog RTL 设计 - 有限状态机的设计
第17任务： Verilog RTL 设计 - 同步FIFO和异步FIFO的设计1
第18任务： Verilog RTL 设计 - 同步FIFO和异步FIFO的设计2
第19任务： Verilog小结
第20任务： SystemVerilog小结
第21任务： CDC-Metastability
第22任务： CDC-五大问题和解决方案
第23任务： CDC设计实例
第24任务： CDC设计实例2
第25任务： TCL基础1
第26任务： TCL基础2
第27任务： 实训项目芯片介绍
第28任务： 实训项目芯片详细设计
第29任务： Architecture Specification
第30任务： Design Specification
第31任务： AMBA总线协议1
第32任务： AMBA总线协议2
第33任务： AMBA总线协议3
第34任务： AMBA Summary1
第35任务： AMBA Summary2
第36任务： 基于AHB-APB bus Slave设计详解
第37任务： Verilog For Design
第38任务： Verilog For Verification
第39任务： 基于AHB Bus SRAM控制器的设计
第40任务： AHB-SRAMC Design
第41任务： Memory BIST
第42任务： Verilog RTL编码风格介绍
第43任务： AHB-SRAMC RTL1
第44任务： AHB-SRAMC RTL2
第45任务： Python1
第46任务： python2
第47任务： python3
第48任务： python4
第49任务： AHB-eflash控制器设计1
第50任务： AHB-eflash控制器设计2
第51任务： AHB-eflash控制器设计3
第52任务： AHB-eflash控制器设计4
第53任务： AHB-eflash控制器设计5
第54任务： AHB-eflash控制器设计6
第55任务： AHB-eflash控制器简介7
第56任务： AHB-eflash控制器简介8
第57任务： AHB-eflash控制器设计9
第58任务： AHB-eflash控制器设计10
第59任务： SD协议介绍
第60任务： SD协议介绍
第61任务： SD协议介绍03
第62任务： SD协议介绍04时序
第63任务： SD协议介绍05
第64任务： SD协议介绍06
第65任务： SD协议介绍07
第66任务： SD协议介绍08
第67任务： SD协议介绍09
第68任务： SD协议介绍10
第69任务： SD协议介绍11
第70任务： python脚本工具开发
第71任务： SD协议介绍12
第72任务： SD协议介绍13
第73任务： SD协议介绍14
第74任务： SD协议介绍15
第75任务： SD协议介绍16
第76任务： TCL脚本工具开发
第77任务： Low Power Design01
第78任务： Low Power Design02
第79任务： 综合基本概念介绍
第80任务： Design and Technology Data1
第81任务： Design and Technology Data2
第82任务： Design and Library Objects
第83任务： lab1逻辑综合基本流程
第84任务： Timing Constraints1
第85任务： Timing Constraints2
第86任务： 数字电路时序分析基础
第87任务： 实验手册lab3_时序分析
第88任务： 环境属性
第89任务： 实验手册lab4_环境属性
第90任务： 优化技术1
第91任务： 优化技术2
第92任务： 实验手册lab5_综合技术
第93任务： 附加约束选项
第94任务： 附加约束选项lab
第95任务： multiple clock
第96任务： congestion analysis and optimization1
第97任务： congestion analysis and optimization2
第98任务： DC输出1
第99任务： DC综合答疑课
第100任务： DC输出2
第101任务： Conclusion
第102任务： eflash IP compile
第103任务： Design and Technology Data 2
第104任务： 形式验证基本概念
第105任务： 形式验证实验
第106任务： 形式验证流程
第107任务： 综合概述
