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《数字IC验证工程师就业班》2104期
第17任务： Verilog RTL设计 - 经典组合逻辑和时序逻辑05
查看课程
任务列表
第1任务： 数字IC设计流程1
第2任务： 数字IC设计流程2
第3任务： SoC芯片架构
第4任务： Linux基本操作01
第5任务： Linux基本操作02
第6任务： GVIM基本操作
第7任务： GVIM正则表达式01
第8任务： GVIM正则表达式02
第9任务： 第一次作业答疑
第10任务： 数字集成电路基础01
第11任务： 数字集成电路基础02
第12任务： 数字集成电路基础03
第13任务： Verilog RTL设计 - 经典组合逻辑和时序逻辑01
第14任务： Verilog RTL设计 - 经典组合逻辑和时序逻辑02
第15任务： Verilog RTL设计 - 经典组合逻辑和时序逻辑03
第16任务： Verilog RTL设计 - 经典组合逻辑和时序逻辑04
第17任务： Verilog RTL设计 - 经典组合逻辑和时序逻辑05
第18任务： 第二次作业答疑
第19任务： 传统Verilog验证平台
第20任务： 验证计划
第21任务： SystemVerilog验证平台架构
第22任务： SystemVerilog - Interface
第23任务： SystemVerilog - Clocking block
第24任务： SystemVerilog - Program
第25任务： SystemVerilog - 数据类型01
第26任务： 第三次作业答疑01
第27任务： 第三次作业答疑02
第28任务： SystemVerilog - 数据类型02
第29任务： SystemVerilog - 数据类型03
第30任务： SystemVerilog项目实践 - AHB-SRAMC - 设计01
第31任务： SystemVerilog项目实践 - AHB-SRAMC - 设计02
第32任务： SystemVerilog项目实践 - AHB-SRAMC - 设计03
第33任务： SystemVerilog项目实践 - AHB-SRAMC - 设计04
第34任务： SystemVerilog项目实践 - AHB-SRAMC - 设计05
第35任务： SystemVerilog项目实践 - TestBench搭建01 - AHB接口实现01
第36任务： SystemVerilog项目实践 - TestBench搭建02 - AHB接口实现02
第37任务： SystemVerilog项目实践 - TestBench搭建03 - AHB接口实现03
第38任务： SystemVerilog - 编程基础
第39任务： 第三次作业答疑03
第40任务： SystemVerilog - 面向对象的编程01
第41任务： SystemVerilog - 面向对象的编程02
第42任务： SystemVerilog - 面向对象的编程03
第43任务： SystemVerilog项目实践 - TestBench搭建04 - 组件的类的实现01
第44任务： SystemVerilog项目实践 - TestBench搭建05 - 组件的类的实现02
第45任务： SystemVerilog - 受约束的随机化01
第46任务： SystemVerilog - 受约束的随机化02
第47任务： SystemVerilog - 并发线程01
第48任务： SystemVerilog - 并发线程02
第49任务： SystemVerilog项目实践 - TestBench搭建06 - 使用fork_join启动
第50任务： SystemVerilog - 进程间通信01
第51任务： SystemVerilog - 进程间通信02
第52任务： SystemVerilog项目实践 - TestBench搭建07 - 组件通信
第53任务： SystemVerilog项目实践 - TestBench搭建08 - 计分板（参考模型）
第54任务： SystemVerilog项目实践 - TestBench搭建09 - 验证平台优化和debug
第55任务： SystemVerilog - 覆盖率01
第56任务： SystemVerilog - 覆盖率02
第57任务： SystemVerilog - 覆盖率03
第58任务： SystemVerilog项目实践 - TestBench搭建10 - 覆盖率
第59任务： SystemVerilog项目实践 - TestBench搭建11 - 覆盖率02
第60任务： SystemVerilog - 断言概述01
第61任务： SystemVerilog - 断言概述02
第62任务： SystemVerilog - sequence 01
第63任务： SystemVerilog - sequence 02
第64任务： SystemVerilog - Property 01
第65任务： 第四次、五次作业答疑
第66任务： 第六次、七次作业答疑
第67任务： 第八次作业答疑
第68任务： SystemVerilog项目实践 - TestBench搭建12 - 测试用例的编写
第69任务： SystemVerilog项目实践 - TestBench搭建13 - 测试用例的编写02
第70任务： SystemVerilog项目实践 - TestBench搭建14 - 覆盖率DB和合并
第71任务： SystemVerilog项目实践 - TestBench搭建15 - 仿真回归报告
第72任务： SystemVerilog测验
第73任务： OOP overview
第74任务： UVM TestBench架构01
第75任务： UVM TestBench架构02
第76任务： UVM TestBench架构03
第77任务： UVM TestBench架构04
第78任务： UVM TestBench架构05
第79任务： UVM TestBench - Hi UVM
第80任务： UVM 实验 - DUT设计
第81任务： UVM - 事务建模
第82任务： UVM - 事务建模02
第83任务： UVM - sequence机制01
第84任务： UVM - sequence机制02
第85任务： 第十二次作业答疑1 - uvm_lab1
第86任务： 第十二次作业答疑2 - uvm_lab2，3
第87任务： UVM - configure 机制01
第88任务： UVM - configure 机制02
第89任务： UVM - TLM01
第90任务： UVM - TLM02
第91任务： UVM - 计分板和覆盖率
第92任务： 第十三次作业答疑 - UVM lab4
第93任务： 第十三次作业答疑02 - UVM lab4
第94任务： UVM - Callback机制
第95任务： UVM - Phase机制
第96任务： UVM - Virtual Sequence 和 Virtual Sequencer
第97任务： UVM - Sequence Library
第98任务： 第十三次作业03 - UVM lab5
第99任务： UVM - RAL01
第100任务： UVM - RAL02
第101任务： UVM - RAL03
第102任务： UVM - RAL04
第103任务： UVM summary
第104任务： 你能不能通过面试01
第105任务： 你能不能通过面试02
第106任务： AHB_SRAMC实践项目01 - 数字IC验证流程
第107任务： AHB_SRAMC实践项目02 - 验证计划
第108任务： AHB_SRAMC实践项目03 - 搭建TB框架
第109任务： AHB_SRAMC实践项目04 - 完善TB功能
第110任务： AHB_SRAMC实践项目05 - TB Debug
第111任务： AHB_SRAMC实践项目06 - 编写testcase
第112任务： AHB_SRAMC实践项目07 - RTL Debug
第113任务： AHB_SRAMC项目实践08 - Regression and coverage
第114任务： APB_SPI实践项目01 - Design SPEC - APB协议
第115任务： APB_SPI实践项目02 - Design SPEC - SPI协议
第116任务： APB_SPI实践项目03 - Design SPEC - 功能概述
第117任务： APB_SPI实践项目04 - Design SPEC - 功能概述2
第118任务： APB_SPI实践项目05 - 验证计划
第119任务： APB_SPI实践项目06 - 验证计划2
第120任务： APB_SPI实践项目07 - 验证环境概述
第121任务： APB_SPI实践项目08 - 验证环境概述02
第122任务： APB_SPI实践项目09 - 验证环境详细设计01
第123任务： APB_SPI实践项目10 - 验证环境详细设计02
第124任务： APB_SPI实践项目11 - 验证环境详细设计03
第125任务： APB_SPI实践项目12 - 覆盖率模型和测试用例
第126任务： APB_SPI实践项目13 - Debug
