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工程实训——SystemVerilog Verification
第30任务： SV-SVA-02
查看课程
任务列表
第1-1任务： SVTB_01_DUT
第1-2任务： SVTB_01_DUT的基本功能框图和时序图
第2任务： SVTB-02-SystemVerilog验证平台
第3任务： SVTB-Lab1
第4-1任务： SVTB_03_VCS_基本操作
第4-2任务： SVTB_03_基本语义和语法的仿真
第5任务： SystemVerilog语法基础-01
第6任务： SystemVerilog语法基础-02
第7-1任务： SVTB-04-SV输出驱动输入采样
第7-2任务： SVTB_04_验证平台的驱动和采样
第8任务： SVTB-04-验证平台的驱动和采样
第9-1任务： SVTB-05-并发操作
第9-2任务： SVTB_05_monitor和selfcheck的驱动和采样
第10任务： SVTB-Lab2
第11任务： SVTB_05_monitor和selfcheck的驱动和采样
第12任务： SVTB-Lab3
第13任务： SVTB-06-封装
第14任务： SVTB-07-随机化
第15-1任务： SVTB_07_数据建模
第15-2任务： SVTB_07_数据建模
第16任务： SVTB-Lab4
第17任务： SVTB-08-继承
第18任务： SVTB-09-内部通信
第19-1任务： SVTB_09_随机化验证
第19-2任务： SVTB_09_随机化验证
第20任务： SVTB-Lab5
第21任务： SVTB-10-功能覆盖率
第22任务： 18-SVTB-11-UVM概述
第23任务： SV-DPI-01
第24任务： SV-DPI-02
第25任务： SV-DPI-03
第26任务： SV-DPI-04
第27任务： SV-DPI-05
第28任务： SV-DPI-06
第29任务： SV-SVA-01
第30任务： SV-SVA-02
第31任务： SV-SVA-03
第32任务： SV-SVA-04
第33任务： SV-SVA-05
