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工程实训 — 基于Verilog和SystemVerilog的VLSI设计
第32任务： 32_实验3_DC 基本操作1
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任务列表
第1-1任务： 第01章-基于HDL的设计流程-01
第1-2任务： 作业_第一章 基于HDL的数字集成电路设计流程
第2任务： 第01章-基于HDL的设计流程-02
第3-1任务： 第02章-Verilog语言简介-01
第3-2任务： 作业_第二章 Verilog语言简介
第4任务： 第02章-Verilog语言简介-02
第5任务： 第02章-Verilog语言简介-03
第6-1任务： 第03章-Verilog仿真平台及数字逻辑仿真-01
第6-2任务： 作业_第三章 Verilog仿真平台及数字逻辑仿真
第7任务： 第03章-Verilog仿真平台及数字逻辑仿真-02
第8-1任务： 第四章 Verilog结构级描述和操作符-01
第8-2任务： 作业_第四章 Verilog结构级描述和操作符
第9任务： 第四章 Verilog结构级描述和操作符-02
第10-1任务： 第五章 Verilog 行为级建模-01
第10-2任务： 作业_第五章 Verilog 行为级建模
第11任务： 第五章 Verilog 行为级建模-02
第12任务： 第五章 Verilog 行为级建模-03
第13-1任务： 第六章 Verilog中的任务函数和可综合性编码原则-01
第13-2任务： 作业6_第六章 Verilog中的任务函数和可综合性编码原则
第14任务： 第六章 Verilog中的任务函数和可综合性编码原则-02
第15任务： 第六章 Verilog中的任务函数和可综合性编码原则-03
第16-1任务： 第七章 Verilog 延时模型-01
第16-2任务： 作业7_第七章 Verilog延时模型
第17任务： 第七章 Verilog 延时模型-02
第18-1任务： 第八章 Verilog 对验证的支持-01
第18-2任务： 作业8_第八章 Verilog 对验证的支持
第19任务： 第八章 Verilog 对验证的支持-02
第20-1任务： 第九章 system verilog介绍 SystemVerilog 声明的位置
第20-2任务： 作业9_第二章 SystemVerilog 声明的位置
第21-1任务： 第十章 systemVerilog文本值和数据类型
第21-2任务： 作业10_第三章-SystemVerilog文本值和数据类型
第22-1任务： 第十一章 用户自定义和枚举数据类型
第22-2任务： 作业11_第四章-用户自定义和枚举数据类型
第23-1任务： 第十二章 数组、结构体和联合体-01
第23-2任务： 作业12_第五章-数组、结构体和联合体
第24任务： 第十二章 数组、结构体和联合体-02
第25-1任务： 第十三章 SystemVerilog过程块、任务和函数
第25-2任务： 作业13_第六章-SystemVerilog过程块、任务和函数
第26-1任务： 第十四章 过程语句
第26-2任务： 作业14_第七章-过程语句
第27-1任务： 第十五章 有限状态机建模
第27-2任务： 作业15_第八章-有限状态机建模
第28-1任务： 第十六章 设计层次
第28-2任务： 作业16_第九章-设计层次
第29-1任务： 第十七章 接口
第29-2任务： 作业17_第十章-接口
第30任务： 30 实验1 VCS基本操作1
第31任务： 31 实验2 VCS基本操作2
第32任务： 32_实验3_DC 基本操作1
第33任务： 33_实验4_DC 基本操作2
第34任务： 34_实验5_spyglass lint 与cdc
